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EM250
Figure 15. Timer Output Generation Mode Example—Alternating, Non-inverting
5.4.4
Timer Functionality (Input Capture)
There are two capture registers that store the timer count value on a trigger condition from GPIO signals. The
timer trigger signals TMR1IA and TMR1IB for Timer 1, and TMR2IA and TMR2IB for Timer 2 are provided by
external signals routed to the GPIO pins.
These timer trigger signals are synchronized to the main 12MHz clock, passed to an optional glitch filter, and
followed by an edge detection circuitry.
These functions are controlled by software with the register bits TMR_CAPMOD[1:0] , and TMR_CAPFILT in the
TMR1_CAPCFGA , TMR1_CAPCFGB , TMR2_CAPCFGA , and TMR2_CAPCFGB registers.
Table 32. GPIO/Timer Trigger Conditioning
TMR_CAPMOD[1:0]
0
1
2
3
Detection mode
Disabled
Rising Edge
Falling Edge
Either Edge
All glitch filters consist of a flip-flop-driven, 4-bit shift register clocked with the main 12MHz clock.
Page 87
120-0082-000V Rev 1.1
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